檢索結果:共4筆資料 檢索策略: cadvisor.raw="方劭云" and ckeyword.raw="機器學習"
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隨著半導體製程持續的縮減,標準元件也變得更小。因此,設計規則的數量大幅增加,讓實體設計流程變得更困難,尤其是標準元件的繞線階段,很多設計規則違反可能會出現在此階段。由於複雜的設計規則和有限的繞線資源…
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電壓降和有效電阻是評估現代積體電路設計中電源傳輸網路穩健性的關鍵指標。在現今積體電路設計流程中的工程改變命令(ECO)階段需要對電源傳輸網路進行迭代調整,過程中需要多次啟動電源傳輸網路分析工具來評估…
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隨著先進製程快速發展以及半導體產業的蓬勃發展,晶片大小也越來越小,因此有更多複雜的設計規則需要被遵守,而一個晶片在被下線之前必須沒有違反任何一個設計規則,這導致一個電路的可繞度就變得相對重要許多。此…
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現今超大型積體電路(VLSI)設計為了滿足電路對於性能、面積和功率消耗嚴格的要求,如何在設計流程早期階段提供準確的功率消耗估算,對於現代超大型積體電路設計中晶片上系統(SoC)的設計探索和驗證至關重…