檢索結果:共8筆資料 檢索策略: ckeyword.raw="極化碼解碼器" and ckeyword.raw="極化碼解碼器"
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本篇論文提出了一種高吞吐量(High Throughput)置信度傳播解碼器(belief propagation decoder)並且使用超大型積體電路(very-large-scale …
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本篇論文提出一種應用於5G的極化碼(Polar Code)置信度傳播位元翻轉解碼器,並用FPGA與超大型積體電路設計與實現,硬體架構上以碼率(0.5)設計多種碼長,主要目標為實現出置信度傳播翻轉解碼…
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本論文提出應用於5G的極化碼(Polar Code)解碼器,使用置信度傳播演算法,並專注於改善極化碼置信度傳播位元翻轉解碼的高疊代次數帶來的高延遲。超大型積體電路(VLSI)設計與實現,在硬體架構上…
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本文為針對極化碼(Polar code)置信傳播列表(Belief Propagation List)解碼器提出新式超大型積體電路(VLSI)硬體設計與實作,設計上以減少硬體消耗為主。藉由重複利用計…
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本文主要目標在探討深度學習極化碼(Polar Code)解碼器是否可以在脈衝雜訊(Impulse Noise)干擾下,能透過全連接式神經網路的學習,讓接收器可以有更好的更正錯誤能力。 對於有線通…
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本論文提出極化碼(Polar code)置信度傳播暨神經網路位元翻轉解碼器,並且使用超大型積體電路(Very Large Scale Integration, VLSI)硬體設計,主要目標為提高置信…
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本論文提出應用於5G的基於多路線連續消除演算法極化碼(Polar Code)解碼器,超大型積體電路(VLSI)設計與實現,在硬體架構上以設計多種碼率及碼長,以及降低面積為主要目標。 其中運算參數及主…
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本論文提出了可配置極化碼(Polar Code)逐次干擾抵銷(Successive Cancellation)解碼器超大型積體電路(VLSI)設計與實作,在硬體架構上以降低面積為目標。在新架構上利用…