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    基於AXI4介面的管線式AES矽智財設計與驗證
    • 電子工程系 /107/ 碩士
    • 研究生: 張祐菘 指導教授: 林銘波
    • 論文中提出了一個符合AXI4介面的管線式AES加解密矽智財設計,注重其核心的面積大小及吞吐量,減少所需硬體資源並提升運算效能。依據AES演算法實現出來的加解密晶片,輸入的每一筆資料為128位元。金鑰…
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    • 全文公開日期 2024/07/22 (校內網路)
    • 全文公開日期 本全文未授權公開 (校外網路)
    • 全文公開日期 本全文未授權公開 (國家圖書館:臺灣博碩士論文系統)
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